下面是范文網(wǎng)小編收集的eda實(shí)驗(yàn)心得體會3篇 eda技術(shù)實(shí)驗(yàn)心得，供大家賞析。

eda實(shí)驗(yàn)心得體會1

　　XX大學(xué)

　　UNIVERSITY 《EDA技術(shù)》實(shí)驗(yàn)報(bào)告

　　學(xué)

　　院：電子與信息工程學(xué)院

　　專

　　業(yè)：電子信息科學(xué)與技術(shù)

　　姓

　　名：

　　XXX

　　班

　　級：

　　XXX

　　學(xué)

　　號：

　　XXXXXXXXX

　　指導(dǎo)老師：

　　XXX

　　這是模板，僅供參考，做實(shí)驗(yàn)報(bào)告的步驟都有，大家最好自己操練下，里面只有三個(gè)實(shí)驗(yàn)的例子

　　MAX+plus 實(shí)驗(yàn)名稱：設(shè)計(jì)作業(yè)（實(shí)驗(yàn)一）四選一多路選擇器

　　一、實(shí)驗(yàn)?zāi)康模菏煜AX+plus軟件的操作及應(yīng)用

　　二、實(shí)驗(yàn)步驟

　　1建立存儲工程的文件夾，如下：

　　2.打開MAX+plusii軟件

　　3.建立工程

　　4.新建文本文件并以VHD格式保存（注意保存的名稱要和代碼中實(shí)體的名稱一致如）

　　5.敲入mux21代碼使其生成四選一芯片

　　點(diǎn)擊MAX+puls II/Compiler進(jìn)行編譯

　　點(diǎn)擊File/Edit Symbol即可對生成的四選一芯片進(jìn)行編輯

　　6.建立電路圖文件并保存（注意保存的名字不能與文本名字一致）

　　然后在空白處點(diǎn)擊右鍵再點(diǎn)擊Enter symbol,雙擊剛剛建立的芯片即可

　　接下來就構(gòu)建原理圖了

　　進(jìn)行編譯后，如果要下載到開發(fā)板上的話還要選擇引腳

　　點(diǎn)擊此處拖到芯片的引腳即可

　　7.建立波形圖并保存

　　點(diǎn)擊Node/Enter Nodes From...這樣在波形圖中就把電路圖的輸入輸出引腳全部調(diào)進(jìn)來了 在里面選擇各個(gè)輸入引腳的的信號就行了

　　經(jīng)過編譯后再仿真(點(diǎn)擊MAX +plus/simulator)就可得到輸出的波形了 MAX+plus 設(shè)計(jì)作業(yè)（實(shí)驗(yàn)二）實(shí)驗(yàn)名稱：全加器的制作

　　一、實(shí)驗(yàn)?zāi)康模菏炀氄莆誐AX+plus軟件的操作

　　二、實(shí)驗(yàn)步驟

　　1.組成部件半加器源代碼 library ieee;use _logic_;use _logic_;use _logic_;entity H_addr is port(a,b :in std_logic;co,so:out std_logic);end H_addr;architecture a of H_addr is begin so

　　圖一

　　3 時(shí)序仿真圖形

　　MAX+plus 設(shè)計(jì)作業(yè)（實(shí)驗(yàn)三）實(shí)驗(yàn)名稱：矩陣鍵盤的制作

　　一、實(shí)驗(yàn)?zāi)康模菏煜AX+plus軟件的操作及應(yīng)用

　　二、實(shí)驗(yàn)步驟

　　1 文件的設(shè)計(jì)

　　library ieee;use _logic_;use _logic_;entity scanselect is port(clk:in std_logic;

　　res:in std_logic;in1,in2,in3,in4,in5,in6:in std_logic_vector(3 downto 0);sel:out std_logic_vector(2 downto 0);daout:out std_logic_vector(3 downto 0));end scanselect;architecture behave of scanselect is begin PROCESS(clk)VARIABLE cnt:std_logic_vector(2 downto 0);BEGIN IF(clk'event AND CLK='1')THEN

　　if res='0'then

　　cnt:="000";

　　else IF cnt="101" THEN cnt:="000";ELSE cnt:=cnt+1;END IF;END IF;if cnt="000" then daout(0)

　　2.生成的圖形

　　2.電路圖層的設(shè)計(jì)

eda實(shí)驗(yàn)心得體會2

　　eDA課程實(shí)驗(yàn)報(bào)告

----移位相加8位硬件乘法器電路計(jì)

　　ou 1

　　移位相加硬件乘法器設(shè)計(jì)

　　一．實(shí)驗(yàn)?zāi)康?、學(xué)習(xí)移位相加8 位硬件乘法器電路設(shè)計(jì)；

　　2、學(xué)習(xí)應(yīng)用EDA 技術(shù)進(jìn)行項(xiàng)目設(shè)計(jì)的能力

　　二．實(shí)驗(yàn)原理

　　該乘法器是由8位加法器構(gòu)成的以時(shí)序方式設(shè)計(jì)的8位乘法器。其乘法原理是：乘法通過逐項(xiàng)移位相加原理來實(shí)現(xiàn)，從被乘數(shù)的最低位開始，若

　　為1，則乘數(shù)左移后與上一次的和相加；若為0，左移后以全零相加，直至被乘數(shù)的最高位。

　　實(shí)驗(yàn)箱內(nèi)部結(jié)構(gòu)圖

：

　　三．實(shí)驗(yàn)設(shè)備

　　1.安裝QUARTUS II 軟件的PC一臺；

　　2.實(shí)驗(yàn)箱一個(gè) 四．實(shí)驗(yàn)步驟

　　1.輸入下列VHDL程序：

　　2.編譯程序，并連接實(shí)驗(yàn)箱并下載 3.在實(shí)驗(yàn)箱上按下列要求進(jìn)行設(shè)置：

①選擇模式1 ②CLKK控制移位相加速度，接clock0=4Hz ③A[7..0]、B[7..0]輸入數(shù)據(jù) 顯示于此4個(gè)數(shù)碼管上

④DOUT[15..0]接數(shù)碼管8/7/6/5，顯示16位乘積：PIO31—PIO16 ⑤接鍵8（PIO49）：高電平清0，低電平計(jì)算允許

⑥A[7..0]接鍵2/1，輸入8位乘數(shù) PIO7—PIO0（模式1）⑦B[7..0]接鍵2/1，輸入8位被乘數(shù) PIO7—PIO0（模式1）

　　五．實(shí)驗(yàn)結(jié)果

　　實(shí)驗(yàn)程序編譯運(yùn)行后RTL電路圖

　　ou 1）2

（模式

　　實(shí)驗(yàn)RTL電路

　　A[7..0]接鍵2/1，輸入8位乘數(shù)：A2（十六進(jìn)制）B[7..0]接鍵4/3，輸入8位被乘數(shù)：33（十六進(jìn)制）可得結(jié)果DOUT[15..0]：2046（十六進(jìn)制）六：心得體會

　　通過電子設(shè)計(jì)的數(shù)字部分EDA設(shè)計(jì)，我們掌握了系統(tǒng)的數(shù)字電子設(shè)計(jì)的方法，也知道了實(shí)驗(yàn)調(diào)試適配的具體操作方法。

　　通過實(shí)驗(yàn)，進(jìn)一步加深了對EDA的了解，讓我對它有了濃厚的興趣。但是在調(diào)試程序時(shí)，遇到了不少問題，編譯下載程序時(shí)，總是有錯(cuò)誤，在細(xì)心的檢查下，終于找出了錯(cuò)誤和警告，排除困難后，程序編譯就通過了，心里終于舒了一口氣。

　　ou 3

eda實(shí)驗(yàn)心得體會3

　　eda心得體會

【篇1：eda心得體會】

　　eda學(xué)習(xí)心得

　　班號：0-05 學(xué)號：

　　課程剛開始的時(shí)候，對eda技術(shù)很陌生，也感到很茫然，也非常沒有信心，當(dāng)接觸到可編程器件的時(shí)候，看到大家同樣感到很迷惘?；蛟S，在學(xué)習(xí)eda的時(shí)候，我應(yīng)該比別人更有些優(yōu)勢，在雙學(xué)位計(jì)算機(jī)的課程里我已經(jīng)學(xué)過《數(shù)字邏輯》，而eda的一些內(nèi)容也是和《數(shù)字邏輯》直接相關(guān)聯(lián)的。

　　通過一學(xué)期的努力學(xué)習(xí)，查閱了一些相關(guān)技術(shù)的書籍，書中通過大量的圖示對pld硬件特性與編程技術(shù)進(jìn)行了形象的講解，不僅融合了之前學(xué)習(xí)的關(guān)于電路設(shè)計(jì)的知識還將eda的技術(shù)加入其中。對vhdl語言的詳盡講解更是讓我深刻理解了vhdl語言的編程原理。由于本門課程是一門硬件學(xué)習(xí)課程，所以實(shí)驗(yàn)必不可少。通過課程最后實(shí)驗(yàn)，我體會一些vhdl語言相對于其他編程語言的特點(diǎn)。

　　在接觸vhdl語言之前，我已經(jīng)學(xué)習(xí)了c語言，匯編語言，而相對于這些語言的學(xué)習(xí)，vhdl 具有明顯的特點(diǎn)。這不僅僅是由于vhdl 作為一種硬件描述語言的學(xué)習(xí)需要了解較多的數(shù)字邏輯方面的硬件電路知識，包括目標(biāo)芯片基本結(jié)構(gòu)方面的知識更重要的是由于vhdl 描述的對象始終是客觀的電路系統(tǒng)。由于電路系統(tǒng)內(nèi)部的子系統(tǒng)乃至部分元器件的工作狀態(tài)和工作方式可以是相互獨(dú)立、互不相關(guān)的，也可以是互為因果的。這表明，在任一時(shí)刻，電路系統(tǒng)可以有許多相關(guān)和不相關(guān)的事件同時(shí)并行發(fā)生。例如可以在多個(gè)獨(dú)立的模塊中同時(shí)入行不同方式的數(shù)據(jù)交換和控制信號傳輸，這種并行工作方式是任何一種基于cpu 的軟件程序語言所無法描繪和實(shí)現(xiàn)的。傳統(tǒng)的軟件編程語言只能根據(jù)cpu 的工作方式，以排隊(duì)式指令的形式來對特定的事件和信息進(jìn)行控制或接收。在cpu 工作的任一時(shí)間段內(nèi)只能完成一種操作。因此，任何復(fù)雜的程序在一個(gè)單cpu 的計(jì)算機(jī)中的運(yùn)行，永遠(yuǎn)是單向和一維的。因而程序設(shè)計(jì)者也幾乎只需以一維的思維模式就可以編程和工作了。

　　在學(xué)習(xí)的過程中，我深深體會到，學(xué)習(xí)不單單要將理論知識學(xué)扎實(shí)了，更重要的是實(shí)際動(dòng)手操作能力，學(xué)完了課本知識，我并沒有覺得自己有多大的提高，相反的，每次做完實(shí)驗(yàn)之后，都會感覺自己收獲不少，因此，我認(rèn)為在老師今后的教學(xué)當(dāng)中，應(yīng)當(dāng)更加注重動(dòng)手實(shí)驗(yàn)，把理論與實(shí)踐很好的結(jié)合起來，才能使同學(xué)融會貫通。

【篇2：eda學(xué)習(xí)心得】

　　eda 學(xué)習(xí)心得

　　姓名：賀鑫學(xué)號： 班號：0-10

　　首先，通過對這門課程相關(guān)理論的學(xué)習(xí)，我掌握了eda的一些基本的的知識，現(xiàn)代電子產(chǎn)品的性能越來越高，復(fù)雜度越來越大，更新步伐也越來越快。實(shí)現(xiàn)這種進(jìn)步的主要原因就是微電子技術(shù)和電子技術(shù)的發(fā)展。前者以微細(xì)加工技術(shù)為代表，目前已進(jìn)入超深亞微米階段，可以在幾平方厘米的芯片上集成幾千萬個(gè)晶體管；后者的核心就是電子設(shè)計(jì)自動(dòng)化eda（electronic design automatic）技術(shù)。eda是指以計(jì)算機(jī)為工作平臺，融合了應(yīng)用電子技術(shù)、計(jì)算機(jī)技術(shù)、智能化技術(shù)的最新成果而開發(fā)出的電子cad通用軟件包，它根據(jù)硬件描述語言hdl完成的設(shè)計(jì)文件，自動(dòng)完成邏輯編譯、化簡、分割、綜合、優(yōu)化、布局布線及仿真，直至完成對于特定目標(biāo)芯片的適配編譯、邏輯映射和編程下載等工作。

　　eda技術(shù)的出現(xiàn)，極大地提高了電路設(shè)計(jì)的效率和可操作性，減輕了設(shè)計(jì)者的勞動(dòng)強(qiáng)度。

　　其次，通過對課程的實(shí)驗(yàn)的學(xué)習(xí)，我對eda的學(xué)習(xí)和理解有了更深刻的認(rèn)識和體會。我們團(tuán)隊(duì)共四個(gè)人，做的是兩層電梯控制器，作為這個(gè)實(shí)驗(yàn)的一員與負(fù)責(zé)人，我感到很有壓力。因?yàn)橹粚φn本知識的學(xué)習(xí)，我對實(shí)驗(yàn)做成功的把握不是很大。因?yàn)槲覀兪菣C(jī)械專業(yè)，學(xué)習(xí)電的知識也主要是通過大二學(xué)的《電工學(xué)》，因此只能對數(shù)字邏輯與數(shù)字電路有初步的了解，而eda是在數(shù)字電路發(fā)展到一定階段的產(chǎn)物，因此學(xué)習(xí)起來也很費(fèi)力。

　　然而，在我們團(tuán)隊(duì)的共同努力下，我們最終成功地完成了這個(gè)實(shí)驗(yàn)，包括時(shí)序仿真和硬件測試仿真，都取得了非常成功地效果。

　　在上實(shí)驗(yàn)課的時(shí)候，那個(gè)周六下午，整個(gè)實(shí)驗(yàn)室只有那寥寥幾人，我很慶幸我是其中的一人，因?yàn)樵谀抢镂覍W(xué)習(xí)到了很多，我完成了上次實(shí)驗(yàn)沒有完成的掃描顯示的實(shí)驗(yàn)，也完成了步進(jìn)電機(jī)控制器的實(shí)驗(yàn)，還在老師的指導(dǎo)下完成了梁祝音樂演示實(shí)驗(yàn)，最后在晚上我也去了實(shí)驗(yàn)室，和我們團(tuán)隊(duì)成員開始進(jìn)行兩層電梯控制器的設(shè)計(jì)，通過一個(gè)晚上的努力，我們最終把它給調(diào)試了出來。

　　通過實(shí)驗(yàn)，我激發(fā)了eda學(xué)習(xí)的興趣，也對這門課程有了更深的理解，對eda設(shè)計(jì)軟件quarter Ⅱ的使用也更加熟練。老師給我們的材料中，用的是gal器件，我們最終用的是fpga器件，也就是ep1k10tc100—3芯片，我們分析了電梯在整個(gè)運(yùn)行過程中的狀態(tài)，并參考資料寫出了狀態(tài)圖，然后根據(jù)狀態(tài)圖用有限狀態(tài)機(jī)來實(shí)現(xiàn)了各個(gè)狀態(tài)之間的轉(zhuǎn)換，進(jìn)而實(shí)現(xiàn)了對電梯的控制。

　　在設(shè)計(jì)過程中，我們遇到了很多困難，尤其是在電梯開門于關(guān)門那個(gè)自動(dòng)控制方面，起初我想用一個(gè)延遲信號賦值語句解決這個(gè)問題，但是由于這個(gè)延遲在綜合器里面不能得到體現(xiàn)，綜合器在綜合是會忽略after之后的延遲，因此我該用了一個(gè)計(jì)數(shù)器溢出的底層元件。通過元件例化語句實(shí)現(xiàn)在頂層文件中對其的調(diào)用。

　　在完成vhdl的編輯以后，進(jìn)行編譯，結(jié)果出現(xiàn)了很多錯(cuò)誤，在我們細(xì)心的檢查和排

　　對這門課程的最大收獲除了學(xué)習(xí)到了知識以外，更重要的是讓我明白了一個(gè)道理：只要全身心的投入到一件事中，并且要有持之以恒的決心，就一定會有收獲。有的人覺得自己做不出來，就網(wǎng)上搜一個(gè)了事，但是，放棄一次黑暗中摸索的經(jīng)歷，就放棄了一次成長的機(jī)會！如果你付出了，沒有收獲。那只能說，是付出的還不夠多。

　　我想我對eda的學(xué)習(xí)只能算是個(gè)入門，這個(gè)領(lǐng)域的發(fā)展空間非常大，應(yīng)用范圍也非常廣泛，而且我相信在將來還會有更加廣闊的應(yīng)用前景。因此在以后的學(xué)習(xí)過程中，我不能因?yàn)檎n程學(xué)習(xí)的結(jié)束而結(jié)束了我對這個(gè)領(lǐng)域的探索，相反我會更加努力的去學(xué)習(xí)它。感謝老師孜孜不倦的教誨，讓我不僅學(xué)到了知識，也學(xué)到了做人做事的一些道理，為我提供了很多幫助。在接下來的學(xué)習(xí)生涯中，我會繼續(xù)努力，努力扎實(shí)地學(xué)習(xí)專業(yè)知識，實(shí)現(xiàn)自己的理想。

【篇3：eda心得體會】

　　eda學(xué)習(xí)心得體會

　　大三時(shí)候開始了專業(yè)課的學(xué)習(xí)，其中eda就是要學(xué)的一門專業(yè)課，課程剛開始的時(shí)候，對eda技術(shù)很陌生，也感到很茫然，也非常沒有信心，當(dāng)接觸到可編程器件的時(shí)候，看到大家同樣感到很迷惘。首先，通過對這門課程相關(guān)理論的學(xué)習(xí)，我掌握了eda的一些基本的的知識，現(xiàn)代電子產(chǎn)品的性能越來越高，復(fù)雜度越來越大，更新步伐也越來越快。實(shí)現(xiàn)這種進(jìn)步的主要原因就是微電子技術(shù)和電子技術(shù)的發(fā)展。前者以微細(xì)加工技術(shù)為代表，目前已進(jìn)入超深亞微米階段，可以在幾平方厘米的芯片上集成幾千萬個(gè)晶體管；后者的核心就是電子設(shè)計(jì)自動(dòng)化eda（electronic design automatic）技術(shù),由于本門課程是一門硬件學(xué)習(xí)課程，所以實(shí)驗(yàn)必不可少。通過課程最后實(shí)驗(yàn)，我體會一些vhdl語言相對于其他編程語言的特點(diǎn)。

　　在接觸vhdl語言之前，我已經(jīng)學(xué)習(xí)了c語言，匯編語言，而相對于這些語言的學(xué)習(xí)，vhdl 具有明顯的特點(diǎn)。這不僅僅是由于vhdl 作為一種硬件描述語言的學(xué)習(xí)需要了解較多的數(shù)字邏輯方面的硬件電路知識，包括目標(biāo)芯片基本結(jié)構(gòu)方面的知識更重要的是由于vhdl 描述的對象始終是客觀的電路系統(tǒng)。由于電路系統(tǒng)內(nèi)部的子系統(tǒng)乃至部分元器件的工作狀態(tài)和工作方式可以是相互獨(dú)立、互不相關(guān)的，也可以是互為因果的。這表明，在任一時(shí)刻，電路系統(tǒng)可以有許多相關(guān)和不相關(guān)的事件同時(shí)并行發(fā)生。因此，任何復(fù)雜的程序在一個(gè)單cpu 的計(jì)算機(jī)中的運(yùn)行，永遠(yuǎn)是單向和一維的。因而程序設(shè)計(jì)者也幾乎只需以一維的思維模式就可以編程和工作了。

　　在學(xué)習(xí)的過程中，我深深體會到，學(xué)習(xí)不單單要將理論知識學(xué)扎實(shí)了，更重要的是實(shí)際動(dòng)手操作能力，學(xué)完了課本知識，我并沒有覺得自己有多大的提高，感覺學(xué)到的很沒用，我們現(xiàn)在學(xué)到的還很少，只是編寫一些簡單的程序。相反的，每次做完實(shí)驗(yàn)之后，都會感覺自己收獲不少，每次都會有問題，因此，我認(rèn)為在老師今后的教學(xué)當(dāng)中，應(yīng)當(dāng)更加注重動(dòng)手實(shí)驗(yàn)，把理論與實(shí)踐很好的結(jié)合起來，才能使同學(xué)融會貫通。現(xiàn)在感覺到對這門課還只有很少的認(rèn)識，所以希望很認(rèn)真的續(xù)下去

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